IDT5V49EE902NLGI【PDF 18/33 页】IC CLOCK GEN PLL 500MHZ 32VFQFPN

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IDT5V49EE902

EEPROM PROGRAMMABLE CLOCK GENERATOR

CLOCK SYNTHESIZER

IDT EEPROM PROGRAMMABLE CLOCK GENERATOR

IDT5V49EE902

REV P 092412

0x28

Reserved

D1[6:0]_CFG0

PLL1 input divider and input sel

D1[6:0] - 127 step Ref Div

D1 = 0 means power down.

0x29

Reserved

D1[6:0]_CFG1

0x2A

Reserved

D1[6:0]_CFG2

0x2B

Reserved

D1[6:0]_CFG3

0x2C

Reserved

D1[6:0]_CFG4

0x2D

Reserved

D1[6:0]_CFG5

0x2E

N1[7:0]_CFG4

N - Feedback Divider

2 - 4095 (value of “0” is not

allowed) Total feedback with A,

using provided calculation

0x2F

N1[7:0]_CFG5

0x30

N1[7:0]_CFG0

0x31

N1[7:0]_CFG1

0x32

N1[7:0]_CFG2

0x33

N1[7:0]_CFG3

0x34

N3[11:8]_CFG0

N1[11:8]_CFG0

PLL3 Feedback Divider

0x35

N3[11:8]_CFG1

N1[11:8]_CFG1

0x36

N3[11:8]_CFG2

N1[11:8]_CFG2

0x37

N3[11:8]_CFG3

N1[11:8]_CFG3

0x38

N3[11:8]_CFG4

N1[11:8]_CFG4

0x39

N3[11:8]_CFG5

N1[11:8]_CFG5

0x3A

CZ2_CFG4

IP2[2:0]_CFG4

RZ2[3:0]_CFG4

PLL2 Loop Parameter

0x3B

CZ2_CFG5

IP2[2:0]_CFG5

RZ2[3:0]_CFG5

0x3C

CZ2_CFG0

IP2[2:0]_CFG0

RZ2[3:0]_CFG0

0x3D

CZ2_CFG1

IP2[2:0]_CFG1

RZ2[3:0]_CFG1

0x3E

CZ2_CFG2

IP2[2:0]_CFG2

RZ2[3:0]_CFG2

0x3F

CZ2_CFG3

IP2[2:0]_CFG3

RZ2[3:0]_CFG3

0x40

Reserved

D2[6:0]_CFG0

PLL2 Reference Divide and Input

Select

D2[6:0] - 127 step Ref Div

D2 = 0 means power down.

0x41

Reserved

D2[6:0]_CFG1

0x42

Reserved

D2[6:0]_CFG2

0x43

Reserved

D2[6:0]_CFG3

0x44

Reserved

D2[6:0]_CFG4

0x45

Reserved

D2[6:0]_CFG5

0x46

N2[7:0]_CFG4

N2[7:0] - PLL2 Feedback Divider

2 - 4095 (value of “0” is not

allowed).

(See Addr 0x4C:0x51 for

N2[15:8])

0x47

N2[7:0]_CFG5

0x48

N2[7:0]_CFG0

0x49

N2[7:0]_CFG1

0x4A

N2[7:0]_CFG2

0x4B

N2[7:0]_CFG3

0x4C

SSENB_CFG0

IP3[4]_CFG0

N2[11:8]_CFG0

N2[11:8] - PLL2 Feedback Divide

PLL3 Spread Spectrum

SSENB - Spread Spectrum

Enable

SSENB = 1 means ON

IP3[4:0] - PLL3 Charge Pump

Current.

0x4D

SSENB_CFG1

IP3[4]_CFG1

N2[11:8]_CFG1

0x4E

SSENB_CFG2

IP3[4]_CFG2

N2[11:8]_CFG2

0x4F

SSENB_CFG3

IP3[4]_CFG3

N2[11:8]_CFG3

0x50

SSENB_CFG4

IP3[4]_CFG4

N2[11:8]_CFG4

0x51

SSENB_CFG5

IP3[4]_CFG5

N2[11:8]_CFG5

0x52

XX1

Reserved

0x53

XX1

Reserved

0x54

XX1

Reserved

0x55

XX1

Reserved

Addr

Default

Register

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IDT5V49EE904NLGI 功能描述:IC PLL CLK GEN 200MHZ 32VFQFN RoHS:是类别:集成电路 (IC) >> 时钟/计时 - 时钟发生器，PLL，频率合成器系列:VersaClock™ III 标准包装:2,000 系列:- 类型:PLL 频率合成器 PLL:是输入:晶体输出:时钟电路数:1 比率 - 输入:输出:1:1 差分 - 输入:输出:无/无频率 - 最大:1GHz 除法器/乘法器:是/无电源电压:4.5 V ~ 5.5 V 工作温度:-20°C ~ 85°C 安装类型:表面贴装封装/外壳:16-LSSOP（0.175"，4.40mm 宽）供应商设备封装:16-SSOP 包装:带卷 (TR) 其它名称:NJW1504V-TE1-NDNJW1504V-TE1TR

IDT5V49EE904NLGI8 功能描述:IC PLL CLK GEN 200MHZ 32VFQFN RoHS:是类别:集成电路 (IC) >> 时钟/计时 - 时钟发生器，PLL，频率合成器系列:VersaClock™ III 标准包装:1,000 系列:- 类型:时钟/频率合成器，扇出分配 PLL:- 输入:- 输出:- 电路数:- 比率 - 输入:输出:- 差分 - 输入:输出:- 频率 - 最大:- 除法器/乘法器:- 电源电压:- 工作温度:- 安装类型:表面贴装封装/外壳:56-VFQFN 裸露焊盘供应商设备封装:56-VFQFP-EP（8x8）包装:带卷 (TR) 其它名称:844S012AKI-01LFT

IDT5V50009DCG 功能描述:IC PC CLOCK 8-SOIC RoHS:是类别:集成电路 (IC) >> 时钟/计时 - 时钟发生器，PLL，频率合成器系列:- 标准包装:39 系列:- 类型:* PLL:带旁路输入:时钟输出:时钟电路数:1 比率 - 输入:输出:1:10 差分 - 输入:输出:是/是频率 - 最大:170MHz 除法器/乘法器:无/无电源电压:2.375 V ~ 3.465 V 工作温度:0°C ~ 70°C 安装类型:* 封装/外壳:* 供应商设备封装:* 包装:*

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